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アルデックは、最新の言語標準をサポートする先進の検証手法を提供して、
お客様が、進化を続ける技術を活用しながら発展することをお約束します。

FPGA デザイン

FPGAベンダーサポートシミュレーションおよびデバッグプロジェクト・マネンジメント/統合環境グラフィカル/テキスト・デザインエントリ HTML/PDF ドキュメンテーション

プロトタイピング

スケーラブルなHES™プロトタイピングプラットフォーム HES Proto-AXIインターコネクトマルチFPGAデザインのパーティショニング ARM Cortexのサポート RTAX/RTSXプロトタイピング

ファンクショナルベリフィケーション

メトリクスドリブン検証 Universal Verification Methodology (UVM)Open Source VHDL Verification Methodology (OSVVM)Universal VHDL Verification Methodology (UVVM)VUnit Cocotb リンティング/デザイン解析 QEMUとRiviera-PROによるコ・シミュレーション非同期クロックドメイン検証

組込システム

Zynq US+ FPGAを使用したディープラーニング FPGAベースのNVMe データストレージモノのインターネット (IoT)自動車ADAS ネットワーキング Aldec 4K UltraHD イメージングソリューション PythonとPYNQ COVID-19の検出

ハードウェア・エミュレーション・ソリューション

協調エミュレーション UVMシミュレーション・アクセラレーションアクセラレーションのスケーラビリティ検証用IP SoCのパーティショニングエミュレーション・デバッギング

ハイパフォーマンス・コンピューティング（HPC）

コンピュータビジョン暗号化・セキュリティゲノムアライメント高頻度トレーディング大規模HPC 組込みHPC

DO-254 コンプライアンス

トレーサビリティ HDL コーディング基準ツール・アセスメントおよびクオリフィケーションのプロセス FPGAレベルのインターゲット・テスト HDL 詳細設計および検証 DO-254テンプレートおよびチェックリスト

特殊アプリケーション

レグレッション・マネージャ暗号化 DSPとRFの協調シミュレーション

イベント

AXI based Design & Verification 11月 07 (ウェブセミナー, Online) AXI based Design & Verification (EU) 11月 07 (ウェブセミナー, Online) FPGA デザイン検証を一言で言うと第2弾 11月 19 (ウェブセミナー, Online) ALINT-PROでバスインターフェースの検証を簡略化する方法 11月 26 (ウェブセミナー, Online) JEVeC DAY 2025 12月 09 (業界イベント, Kawasaki, Japan) すべてのイベントを表示

ウェブセミナーの録画

Boost FPGA Reliability with Advanced Linting and CDC Analysis Bridging Simulation and Hardware: Hardware-in-the-Loop in Action Advanced Static Linting Techniques for High Performance Design Optimization HDLRegression – Automated Regression Testing for VHDL/Verilog FPGA Verification with VHDL and UVVM Part 2: Harnessing the power of VVCs and BFMs すべてのウェブセミナーを表示

ニュースルーム

Versal ACAPのような複雑なSoC FPGAのシミュレーションには何が必要ですか？ 2月 08 Aldec @ DAC 2023：FPGAおよびSoC向け設計検証ツールとソリューションを紹介 6月 26 Riviera-PROがAMD® Versal™ ACAPデザインのシステムシミュレーションをサポート 6月 14 航空電子機器業界で高まる TLM のニーズ 5月 18 アルデックとタレスがCertification Together International Conference 2023で共同発表 5月 01 すべてのニュースを表示

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